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将十六进制数（36.D）H转换成十进制数是（）

A. 36.13
B. 54.13
C. 36.8125
D. 54

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如下Verilog HDL程序所描述的是一个触发器，对它的描述正确的是（）module FF（Q,DATA,CLK）input DATA,CLK;output Q;reg Q; always @ （posedge CLK） begin Q ＜= DATA; endendmodule

A. 该触发器对CLK信号的高电平敏感
B. 该触发器对CLK信号的低电平敏感
C. 该触发器对CLK信号的上升沿敏感
D. 该触发器对CLK信号的下降沿敏感

将二进制数（101.101）B转换成八进制数是（）

A. 5.5
B. 5.625
C. 5.25
D. 5

将十六进制数（4E.C）H转换成二进制数是（）

A. 0100 1110. 0110
B. 0100 1110. 11
C. 1110 0100.11
D. 0100 1110

将二进制数（101101.11）B转换成十进制数是（）

A. 45.3
B. 45.75
C. 46.75
D. 48