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CPU执行一段程序时,Cache完成存取的次数为8000次,主存完成存取的次数为300次。已知Cache存取周期为40ns,主存

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时钟发生器的功能是______。

由于数据通路之间的结构关系,微操作可以分为______和______两种。

一般而言,CPU中至少有______、______、______、______、______和______6个寄存器。

动态RAM和静态RAM都是易失性半导体存储器。( )

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